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摘要現代通信系統要求通信距離遠、通信容量大、傳輸質量好。作為其關鍵技術之一的調制解調技術一直是人們研究的一個重要方向。討論和仿真實現了基于FPGA的數字化DPSK調制解調系統。用Altera公司的FPGA開發平臺Quartus II 3.0實現了一個對基帶信號的DPSK調制解調系統模型的仿真。

現代通信系統要求通信距離遠、通信容量大、傳輸質量好。作為其關鍵技術之一的調制解調技術一直是人們研究的一個重要方向。一個系統的通信質量, 很大程度上依賴于所采用的調制方式。因此,對調制方式的研究, 將直接決定通信系統質量的好壞[1, 2]。隨著超大規模集成電路的發展, 尤其是微電子技術和計算機技術的迅猛發展和廣泛應用, 數字化成為目前通信技術發展的趨勢, 它具有可靠性高、靈活性強、易大規模集成等優點, 日益受到重視。目前, 數字化的手段主要有集成電路（ASIC） 和通用數字信號處理器（DSP） 。現場可編程門陣列（ FPGA） 提供了實現數字信號處理的第三種解決方案, 它結合了以上兩種方式的優勢, 具有開發周期短、設計方案修改方便、成本低、投資不存在風險問題等[3]。本設計選用了Altera公司的APEX20KE系列的FPGA芯片來實現設計。

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